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Text File  |  1995-10-24  |  7KB  |  173 lines
  1. ;================================
  2. ; VPIC values
  3. ;================================
  4. VPIC_values = {
  5. 1       ; Chip version
  6. 0       ; 1: BT885, 0: PCI bus
  7. 0       ; 1: YUV    0: RGB
  8. 0       ; 1: dither on 0: dither off
  9. 0       ; 1: 24 bit 0: 16 bit
  10. 0       ; 1: 15bit/GBR  0: normal
  11. 0       ; 0: 33 Mhz 1: 16 Mhz pixel clock
  12. 0       ; 0: no address checking, 1:64K checking 2: 1M checking
  13. 1       ; VCP read/write timing, 0: no delay, 1: delay, 2: delay more
  14. 0       ; VCP DMA timing, 0: no delay, 1: delay
  15. 0       ; PCI master control 1: filter one cycle gnt
  16. 0       ; PCI master control 1: enable latency timer
  17. 1       ; Enable Screen, 1: Screen1, 2: Screen2
  18. 1024    ; Display map width
  19. 10      ; Screen 1 VCP output X starting
  20. 13      ; Screen 1 VCP output Y starting
  21. 352     ; Screen 1 Display width
  22. 288     ; Screen 1 Display height
  23. 0       ; Screen 1 Display orginal X0
  24. 0       ; Screen 1 Display orginal Y0
  25. 10      ; Screen 1 Mask 1 XL
  26. 100     ; Screen 1 Mask 1 XR
  27. 10      ; Screen 1 Mask 1 YU
  28. 100     ; Screen 1 Mask 1 YD
  29. 230     ; Screen 1 Mask 2 XL
  30. 330     ; Screen 1 Mask 2 XR
  31. 130     ; Screen 1 Mask 2 YU
  32. 230     ; Screen 1 Mask 2 YD
  33. 0       ; Screen 1 Mask enable
  34. 8       ; Screen 2 VCP output X starting
  35. 14      ; Screen 2 VCP output Y starting
  36. 352     ; Screen 2 Display width
  37. 240     ; Screen 2 Display height
  38. 300     ; Screen 2 Display orginal X0
  39. 300     ; Screen 2 Display orginal Y0
  40. 10      ; Screen 2 Mask 1 XL
  41. 100     ; Screen 2 Mask 1 XR
  42. 10      ; Screen 2 Mask 1 YU
  43. 100     ; Screen 2 Mask 1 YD
  44. 230     ; Screen 2 Mask 2 XL
  45. 330     ; Screen 2 Mask 2 XR
  46. 130     ; Screen 2 Mask 2 YU
  47. 230     ; Screen 2 Mask 2 YD
  48. 0       ; Screen 2 Mask enable
  49. }
  50.  
  51. ;======================================================================
  52. ; Choice :
  53. ; 01. Dram size :
  54. ;     HALF MEGA BYTE    = 0x0
  55. ;     ONE MEGA BYTE     = 0x140
  56. l     TWO MB            = 0x40
  57. ; 02. Dram speed
  58. ;     DRAM_SPD4T4T5T    = 0x002a    /* spd=4t, rasdel=4t, raspre=5t */
  59. ;     DRAM_SPD4T2T3T    = 0x0002    /* spd=4t, rasdel=2t, raspre=3t */
  60. ;     DRAM_SPD3T3T4T    = 0x0015    /* spd=3t, rasdel=3t, raspre=4t */
  61. ;     DRAM_SPD3T2T3T    = 0x0001    /* spd=3t, rasdel=2t, raspre=3t */
  62. ;     DRAM_SPD2T2T3T    = 0x0000    /* spd=2t, rasdel=2t, raspre=3t */
  63. ;======================================================================
  64.  
  65.  
  66. mpegdec_vcx_values = {
  67.  
  68. _vcx_dram_config                        0x22a
  69.  
  70. ;======================================================================
  71. ; Put 0x1 if want to init dsp2101, example on dvc3 board
  72. ;======================================================================
  73. _vcx_init_dsp2101                       0
  74. _vcx_dsp_2171                           0
  75. _vcx_scn_mastermode                     1
  76. _vcx_scn_hstart                         10
  77. _vcx_scn_hend                           362
  78. _vcx_scn_hscale                         1
  79. _vcx_scn_horizontalamt                  360
  80. _vcx_scn_hbstartval                     363
  81. _vcx_scn_hbendval                       10
  82. _vcx_scn_uvstartstop                    0x2746
  83. _vcx_scn_ystartstop                     0x2c55
  84. _vcx_scn_vstart                         10
  85. _vcx_scn_vend                           298
  86. _vcx_scn_vscale                         1
  87. _vcx_scn_verticalamt                    240
  88. _vcx_scn_vbstartval                     243
  89. _vcx_scn_vbendval                       3
  90. _vcx_scn_verticalirq                    3
  91. ;======================================================================
  92. _vcx_scn_hsyncperiod                    800
  93. ;=======================================================================
  94. _vcx_scn_hsyncwidth                     2
  95. _vcx_scn_vsyncwidth                     2
  96. _vcx_scn_vcsyncdelayed_even             1
  97. _vcx_bt885_hend_offset                  400
  98. _vcx_scn_hincval                        0x1000
  99. ;=================================================
  100. ; scn_hscalingoff <--- 0x0 for rev.3 silicon supporting scaling
  101. ; scn_hscalingoff <--- 0x1 for rev.2 silicon not supporting scaling
  102. ;=================================================================
  103. _vcx_scn_hscalingoff                    0x0
  104. _vcx_scn_genlock                        0x0
  105. _vcx_scn_dvc4_genlock                   0x0
  106. _vcx_audio_volume                       0x40
  107. _vcx_scn_display_rate                   30
  108. _vcx_scn_width                          352
  109. _vcx_scn_height                         240
  110. _vcx_scn_voffset                        0
  111. _vcx_scn_hoffset                        0
  112. _vcx_scn_forced_horizontal              0
  113. _vcx_playvideo_only                     0
  114. _vcx_scn_inv_sync                       1
  115.  
  116. ;======================================================================
  117. ; scn tap mode
  118. ; 0x0 <- 7 tap, for ntsc dvc3 board
  119. ; 0x4 <- 5 tap
  120. ; 0x8 <- 3 tap, for mpeg board only support rev.3 silcon
  121. ;======================================================================
  122. _vcx_scn_tapmode                        0x8
  123.  
  124. ;======================================================================
  125. ; To turn on clk1xmode, assign 0x2000, example for mpeg_board
  126. ;======================================================================
  127. _vcx_scn_clk1xmode                      0x2000
  128.  
  129. ;======================================================================
  130. ; 0x180 <- yuv mode
  131. ; 0x10  <- rgb 16 mode
  132. ; 0x18  <- rgb 24 mode
  133. ; Init this variable go to vid_scn_outputcntl
  134. ;======================================================================
  135. _vcx_scn_colormode                      0x10
  136. ;======================================================================
  137. ; Screen horizontal scaling coefficients assignment
  138. ;======================================================================
  139. _vcx_scn_bank1_cd    0x115e
  140. _vcx_scn_bank2_cd    0x2158
  141. _vcx_scn_bank3_cd    0x3549
  142. _vcx_scn_bank4_cd    0x0249
  143. _vcx_scn_bank5_cd    0x0758
  144.  
  145. _vcx_scn_bank1_ef    0x1100
  146. _vcx_scn_bank2_ef    0x0700
  147. _vcx_scn_bank3_ef    0x0200
  148. _vcx_scn_bank4_ef    0x3500
  149. _vcx_scn_bank5_ef    0x2100
  150.  
  151. _vcx_scn_bank1_ab                       0x0
  152. _vcx_scn_bank2_ab                       0x0
  153. _vcx_scn_bank3_ab                       0x0
  154. _vcx_scn_bank4_ab                       0x0
  155. _vcx_scn_bank5_ab                       0x0
  156.  
  157. _vcx_scn_bank1_gx                       0x0
  158. _vcx_scn_bank2_gx                       0x0
  159. _vcx_scn_bank3_gx                       0x0
  160. _vcx_scn_bank4_gx                       0x0
  161. _vcx_scn_bank5_gx                       0x0
  162.  
  163. _vcx_timer_val                          33000 ; PCI bus frequenz in kHz   (equal to 33 Mhz bus rate)
  164.  
  165. _vcx_audio_ioport 0x20
  166. _vcx_audio_reset  0x28
  167. _PictureRate  0
  168. _BitRate      0
  169. _birate_index 0
  170. _HorizSz      0
  171. _VertSz       0
  172. }
  173.